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Concurso:
IFB
Disciplina:
Engenharia Eletrônica
Qual é o menor número de flip-flops necessários para se implementar um contador síncrono de módulo 15?
Concurso:
SEAD-AP
Disciplina:
Engenharia Eletrônica
O circuito abaixo é um contador crescente assíncrono, composto por flips-flops T, com clear e preset assíncronos. A indicação “1”, na figura, indica o nível de tensão especificado para o nível lógico “1” (verdade).
Esse contador possui a seguinte quantidade de estados estáveis:
Esse contador possui a seguinte quantidade de estados estáveis:
Concurso:
SEAD-AP
Disciplina:
Engenharia Eletrônica
Considere o seguinte diagrama de estados de uma máquina de estados síncrona, na qual cada estado é designado por dois bits: B2B1, sendo o bit B2 o mais significativo.
Dado que o bit B2 será implementado utilizando um flip-flop D, a sua lógica de próximo estado pode ser expressa por
Dado que o bit B2 será implementado utilizando um flip-flop D, a sua lógica de próximo estado pode ser expressa por
Concurso:
TJ-RS
Disciplina:
Engenharia Eletrônica
Considere as afirmações abaixo em relação a circuitos lógicos sequenciais.
I - O próximo estado de circuitos sequenciais depende não somente do estado atual, podendo depender também das entradas. II - Um flip-flop tipo D, sensível à borda positiva, copia sua entrada para a saída na borda de subida do relógio. III- Um flip-flop tipo D, sensível à borda positiva, troca seu estado quando o relógio faz uma transição do estado 1 para o estado 0.
Quais estão corretas?
I - O próximo estado de circuitos sequenciais depende não somente do estado atual, podendo depender também das entradas. II - Um flip-flop tipo D, sensível à borda positiva, copia sua entrada para a saída na borda de subida do relógio. III- Um flip-flop tipo D, sensível à borda positiva, troca seu estado quando o relógio faz uma transição do estado 1 para o estado 0.
Quais estão corretas?
Concurso:
TRE-BA
Disciplina:
Engenharia Eletrônica
A imagem acima apresenta um circuito sequencial síncrono em que as entradas J2 e K2 do segundo flip-flop estão sempre em nível lógico 1, e as entradas J1 e K1 do primeiro flip-flop estão ambas conectadas à saída Q2 do segundo flip-flop. Caso o estado inicial das saídas Q1 e Q2 seja Q1Q2=00, a sequência correta, Q1Q2, a ser gerada pelo circuito será