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SEAD-AP
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Engenharia Eletrônica
O circuito abaixo é um contador crescente assíncrono, composto por flips-flops T, com clear e preset assíncronos. A indicação “1”, na figura, indica o nível de tensão especificado para o nível lógico “1” (verdade).
Esse contador possui a seguinte quantidade de estados estáveis:
Esse contador possui a seguinte quantidade de estados estáveis:
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SEAD-AP
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Engenharia Eletrônica
Considere o seguinte diagrama de estados de uma máquina de estados síncrona, na qual cada estado é designado por dois bits: B2B1, sendo o bit B2 o mais significativo.
Dado que o bit B2 será implementado utilizando um flip-flop D, a sua lógica de próximo estado pode ser expressa por
Dado que o bit B2 será implementado utilizando um flip-flop D, a sua lógica de próximo estado pode ser expressa por
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SEAD-AP
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Engenharia Eletrônica
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Considerando a implementação de circuitos lógicos com resistores, diodos e transistores, a equação a booleana implementada pelo circuito acima é
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SEAD-AP
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Engenharia Eletrônica
Considerando a seguinte equação booleana:
Assinale a opção que apresenta uma equação booleana equivalente.
Assinale a opção que apresenta uma equação booleana equivalente.
